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项目作者： nobotro

项目描述 ：
fpga verilog risc-v rv32i cpu
高级语言： Verilog
项目地址: git://github.com/nobotro/fpga_riscv_cpu.git
创建时间： 2019-07-07T12:38:44Z
项目社区：https://github.com/nobotro/fpga_riscv_cpu
开源协议：MIT License
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